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AD1852JRS データシート(PDF) 6 Page - Analog Devices |
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AD1852JRS データシート(HTML) 6 Page - Analog Devices |
6 / 16 page AD1852 –6– REV. 0 SDATA INPUT LSB MSB–2 MSB–1 LSB+2 LSB+1 MSB–2 MSB–1 MSB LSB+2 LSB+1 LSB BCLK INPUT L/ RCLK INPUT LEFT CHANNEL RIGHT CHANNEL MSB LSB Figure 1. Right-Justified Mode LEFT CHANNEL RIGHT CHANNEL MSB–2 MSB–1 LSB+2 LSB+1 LSB MSB–2 MSB–1 MSB LSB+2 LSB+1 LSB MSB L/ RCLK INPUT BCLK INPUT SDATA INPUT MSB Figure 2. I2S-Justified Mode MSB–2 MSB–1 LSB+2 LSB+1 LSB MSB–2 MSB–1 MSB LSB+2 LSB+1 LSB MSB–1 MSB L/ RCLK INPUT BCLK INPUT SDATA INPUT LEFT CHANNEL RIGHT CHANNEL MSB Figure 3. Left-Justified Mode SDATA INPUT MSB–1 LSB+2 LSB+1 LSB MSB–1 LSB+2 LSB+1 LSB MSB MSB–1 MSB L/ RCLK INPUT LEFT CHANNEL RIGHT CHANNEL BCLK INPUT MSB Figure 4. Left-Justified DSP Mode L/ RCLK INPUT LEFT CHANNEL RIGHT CHANNEL BCLK INPUT SDATA INPUT LSB MSB–1 MSB–2 LSB+2 LSB+1 LSB MSB MSB–1 MSB–2 LSB+2 LSB+1 LSB MSB MSB–1 MSB Figure 5. 32 × F S Packed Mode |
同様の部品番号 - AD1852JRS |
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同様の説明 - AD1852JRS |
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