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AD9154 データシート(PDF) 4 Page - Analog Devices |
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4 / 124 page AD9154 Data Sheet Rev. B | Page 4 of 124 DETAILED FUNCTIONAL BLOCK DIAGRAM Figure 2. Detailed Functional Block Diagram SYNCOUT0– SYNCOUT0+ PDP OUT1 PDP OUT0 DAC PLL SERDES PLL POWER-ON RESET SERIAL I/O PORT CONFIG REGISTERS DACCLK PLL_LOCK SYNCHRONIZATION LOGIC DAC ALIGN DETECT HB1 SERDIN7± SERDIN0± VTT SYNCOUT1+ SYNCOUT1– REF AND BIAS I120 SYSREF+ SYSREF– HB3 HB2 DACCLK OUT3+ OUT3– f DAC ÷4, ÷8 NCO COMPLEX MODULATION PHASE ADJUST Q GAIN I GAIN SYSREF RCVR CLK+ CLK– MODE CONTROL DACCLK CLK RCVR HB3 HB2 HB1 Q OFFSET I OFFSET HB1 HB3 HB2 MODE CONTROL HB3 HB2 HB1 FSC FSC OUT2+ OUT2– DACCLK OUT1+ OUT1– f DAC ÷4, ÷8 NCO COMPLEX MODULATION PHASE ADJUST Q GAIN I GAIN Q OFFSET I OFFSET FSC FSC OUT0+ OUT0– CLOCK DISTRIBUTION AND CONTROL LOGIC |
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同様の説明 - AD9154 |
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