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MC100EP445FAR2G データシート(PDF) 3 Page - ON Semiconductor |
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MC100EP445FAR2G データシート(HTML) 3 Page - ON Semiconductor |
3 / 19 page MC10EP445, MC100EP445 http://onsemi.com 3 Table 2. TRUTH TABLE PIN FUNCTION High Low SINSEL Select SINB Input Select SINA Input CKSEL Q: PCLK = 8:1 CLK: Q = 1:1 Q CLK Q: PCLK = 8:1 CLK: Q = 1:2 Q CLK CKEN Synchronously Disable Internal Clock Circuitry Synchronously Enable Internal Clock Circuitry RESET Asynchronous Master Reset Synchronous Enable SYNC Asynchronously Applied to Swallow a Data Bit Normal Conversion Process Figure 3. Logic Diagram Q0 1:2 DEMUX 1:2 DEMUX 1:2 DEMUX 1:2 DEMUX Q4 Q2 Q6 Q1 Q5 Q3 Q7 1:2 DEMUX 1:2 DEMUX 1:2 DEMUX DIV2 DIV2 PCLK PCLK SINA SINA SINB SINB SINSEL T C Q R CKSEL T C Q R CKEN CLK CLK RESET SYNC Control Logic VEE |
同様の部品番号 - MC100EP445FAR2G |
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同様の説明 - MC100EP445FAR2G |
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