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ADV202-SD-EB データシート(PDF) 5 Page - Analog Devices |
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ADV202-SD-EB データシート(HTML) 5 Page - Analog Devices |
5 / 40 page ADV202 Rev. 0 | Page 5 of 40 CLOCK AND RESET SPECIFICATIONS Table 3. Parameter Description Min Typ Max Unit tMCLK MCLK Period 13.3 100 ns tMCLKL MCLK Width Low 6 ns tMCLKH MCLK Width High 6 ns tVCLK VCLK Period 13.4 50 ns tVCLKL VCLK Width Low 5 ns tVCLKH VCLK Width High 5 ns tRST RESET Width Low 5 MCLK cycles1 1 For a definition of MCLK, see the section. PLL MCLK VCLK tMCLK tMCLKH tMCLKL tVCLK tVCLKH tVCLKL Figure 2. Input Clock |
同様の部品番号 - ADV202-SD-EB |
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同様の説明 - ADV202-SD-EB |
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