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74AHCT02BQ データシート(PDF) 2 Page - NXP Semiconductors |
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2 / 13 page 74AHC_AHCT02_3 © NXP B.V. 2008. All rights reserved. Product data sheet Rev. 03 — 7 January 2008 2 of 13 NXP Semiconductors 74AHC02; 74AHCT02 Quad 2-input NOR gate 4. Functional diagram 5. Pinning information 5.1 Pinning 5.2 Pin description Fig 1. Logic symbol Fig 2. IEC logic symbol Fig 3. Logic diagram (one gate) mna216 1A 1B 1Y 3 2 1 2A 2B 2Y 6 5 4 3A 3B 3Y 9 8 10 4A 4B 4Y 12 11 13 001aah084 2 1 3 5 4 ≥1 6 ≥1 8 10 ≥1 9 11 13 ≥1 12 mna215 A B Y (1) The die substrate is attached to this pad using conductive die attach material. It can not be used as a supply pin or input. Fig 4. Pin configuration SO14 and TSSOP14 Fig 5. Pin configuration DHVQFN14 02 1Y VCC 1A 4Y 1B 4B 2Y 4A 2A 3Y 2B 3B GND 3A 001aac919 1 2 3 4 5 6 7 8 10 9 12 11 14 13 001aac920 02 Transparent top view 2B 3B 2A 3Y 2Y 4A 1B 4B 1A 4Y 6 9 5 10 4 11 3 12 2 13 terminal 1 index area GND(1) Table 2. Pin description Symbol Pin Description 1Y 1 data output 1A 2 data input 1B 3 data input 2Y 4 data output |
同様の部品番号 - 74AHCT02BQ |
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同様の説明 - 74AHCT02BQ |
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