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AD9122SCPZ-EP-RL データシート(PDF) 3 Page - Analog Devices |
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AD9122SCPZ-EP-RL データシート(HTML) 3 Page - Analog Devices |
3 / 12 page Enhanced Product AD9122-EP Rev. 0 | Page 3 of 12 FUNCTIONAL BLOCK DIAGRAM MULTICHIP SYNCHRONIZATION D15P/D15N D0P/D0N FIFO HB1 HB2 HB3 NCO AND MOD fDATA/2 PRE MOD INTERNAL CLOCK TIMING AND CONTROL LOGIC 16 16 10 16 16 I OFFSET Q OFFSET INV SINC AUX 1.2G DAC 1 16-BIT IOUT1P IOUT1N AUX 1.2G DAC 2 16-BIT IOUT2P IOUT2N REF AND BIAS FSADJ DACCLKP DACCLKN REFCLKP REFCLKN REFIO 10 10 DAC_CLK SERIAL INPUT/OUTPUT PORT PROGRAMMING REGISTERS POWER-ON RESET 0 1 CLOCK MULTIPLIER (2× TO 16×) CLK RCVR CLK RCVR PLL CONTROL SYNC DAC CLK_SEL DAC_CLK PLL_LOCK DCIP/DCIN FRAMEP/FRAMEN Figure 2. |
同様の部品番号 - AD9122SCPZ-EP-RL |
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同様の説明 - AD9122SCPZ-EP-RL |
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